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因工作開(kāi)展需要，現(xiàn)公開(kāi)招聘測(cè)試技術(shù)與儀器研究所第六教研室FPGA工程師崗位（二級(jí)單位聘用人員），具體情況如下。

一、崗位職責(zé)

1.對(duì)整個(gè)產(chǎn)品的生命周期內(nèi)的FPGA設(shè)計(jì)負(fù)責(zé)；

2.根據(jù)項(xiàng)目需要開(kāi)展產(chǎn)品FPGA設(shè)計(jì)技術(shù)評(píng)審，能夠獨(dú)立策劃項(xiàng)目方案并完成方案論證；

3.負(fù)責(zé)高速數(shù)據(jù)采集系統(tǒng)中的數(shù)據(jù)存儲(chǔ)、傳輸及處理等功能模塊的邏輯代碼總體設(shè)計(jì)；

4.代碼規(guī)范制定，代碼評(píng)定及核心FPGA代碼編寫(xiě)；

5.培養(yǎng)團(tuán)隊(duì)，提升團(tuán)隊(duì)整體技能和協(xié)作水平;

6.帶領(lǐng)其他工程師完成所有開(kāi)發(fā)任務(wù);

7.帶領(lǐng)軟件團(tuán)隊(duì)攻克技術(shù)難題，對(duì)FPGA的可靠性負(fù)責(zé)，對(duì)開(kāi)發(fā)進(jìn)度負(fù)責(zé)；

8.完成教研室交辦的其他任務(wù)。

二、崗位要求

專業(yè)要求：電子、通信、自動(dòng)化等專業(yè)本科及以上學(xué)歷。

工作經(jīng)驗(yàn)：至少五年數(shù)字電路設(shè)計(jì)從業(yè)經(jīng)驗(yàn)。

1.精通Verilog語(yǔ)言；

2.熟悉AD數(shù)據(jù)采集存儲(chǔ)系統(tǒng)開(kāi)發(fā)經(jīng)驗(yàn)；

3.JESD204B、Seders、GTX、PCle傳輸，DDR控制器等相關(guān)研發(fā)經(jīng)驗(yàn)者優(yōu)先；

4.有較強(qiáng)的團(tuán)隊(duì)協(xié)作能力和溝通能力，有一定管理能力；

5.身心健康，具有履行崗位職責(zé)所需的身體條件。

三、招聘人數(shù)

2人（校內(nèi)二級(jí)單位聘用人員）。

四、薪資待遇

根據(jù)應(yīng)聘者能力及工作經(jīng)歷面議。

五、招聘方式

1.個(gè)人報(bào)名。有意者請(qǐng)于2026年4月2日下午17:00前將個(gè)人簡(jiǎn)歷及相關(guān)證明材料發(fā)至郵箱（點(diǎn)擊查看），請(qǐng)【點(diǎn)擊下方“立即投遞/投遞簡(jiǎn)歷”，即刻進(jìn)行職位報(bào)名】，文件命名格式為“二級(jí)單位聘用人員應(yīng)聘+姓名+聯(lián)系電話”。

2.資格審查。按照招聘公告明確的資格條件確定參加考察人選。未通過(guò)資格審查者不再另行通知。

3.面試和考核。資格審核通過(guò)者由單位安排面試和考核。

4.公示及聘用。單位對(duì)通過(guò)面試和考核的擬錄取人員進(jìn)行公示。公示期滿且無(wú)異議后，按照學(xué)校規(guī)定與受聘人員簽訂勞動(dòng)合同。新聘任人員實(shí)行試用，按照勞動(dòng)合同法規(guī)定執(zhí)行。

六、特別說(shuō)明

1.應(yīng)聘人員提供的應(yīng)聘材料須真實(shí)、準(zhǔn)確、有效，單位可在招聘各環(huán)節(jié)對(duì)應(yīng)聘者應(yīng)聘資格進(jìn)行審核，如發(fā)現(xiàn)提供虛假材料、隱瞞事實(shí)真相等行為，將取消應(yīng)聘資格；應(yīng)聘人員聘用后被查明有以上行為的，單位有權(quán)與其解除聘用關(guān)系、予以清退，由此產(chǎn)生的一切責(zé)任后果由本人承擔(dān)。

2.本次公開(kāi)招聘不收取任何費(fèi)用，招聘涉及的個(gè)人差旅和食宿自理。

七、聯(lián)系方式

聯(lián)系人：楊老師，028-61836602

電子科技大學(xué)自動(dòng)化工程學(xué)院

2026年3月26日

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